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申请/专利权人：中电科思仪科技(安徽)有限公司

摘要：本发明公开了一种基于5GNR的高精度实时解调方法，采用FPGA芯片、DSP芯片以及工控板，包括以下步骤：FPGA从153.6MHz变采样到122.88MHz，FPGA变采样后的数据通过SRIO实时传输给DSP，存储到DSP外挂的DDR3，DSP利用GPIO中断响应和乒乓切换，实现数据从DDR3到L2RAM的实时读取；DSP对L2RAM的数据利用多核、协处理器实现实时解调，并优化时偏频偏的计算实现高精度解调；DSP将物理层解调结果利用TCP传输给工控板；DSP采用EMAC方式实现自启动。本发明实现了5GNR的高精度实时解调，信号质量指标符合3GPP协议对5GNR解调的要求，还具有设备升级成本低、运行稳定、大容量存储、便于远程升级的优点。

主权项：1.一种基于5GNR的高精度实时解调方法，其特征在于，采用FPGA芯片、DSP芯片以及工控板，包括以下步骤：S1、FPGA变采样；FPGA从153.6MHz变采样到122.88MHz，在不更改板卡的基础上，满足5GNR的100MHz带宽需求，并且兼容4GLTE；S2、SRIO实时传输；FPGA变采样后的数据通过SPIO实时传输给DSP，存储到DSP外挂的DDR3，实现原始IQ数据的大容量实时存储；DSP利用GPIO中断响应和乒乓切换，实现数据从DDR3到L2RAM的实时读取；S3、DSP高精度解调；DSP对L2RAM的数据利用多核、协处理器实现实时解调，并优化时偏频偏的计算实现高精度解调；S4；DSP将物理层解调结果利用TCP传输给工控板；S5、DSP采用EMAC方式实现自启动；在步骤S3中，对于时偏计算，在采用功率触发和CP相关寻找同步点的基础上，增加了DMRS相关计算，从而确定帧头；对于频偏计算，首先采用传统CP计算初始频偏值，并进行补偿，再利用DMRS的信道估计值进行相关计算，从而得到最终频偏值；在步骤S1中，采用的AD芯片为ADC12D500RF，FPGA将输入数据x进行4倍插0后，根据卷积的性质，将带0的项删除，构造122.88153.6*4的低通滤波系数h，将其每隔4点取1点，分为4组数据，标记为h0、h1、h2、h3，将输入数据x分别与h0、h1、h2、h3卷积，得到y0、y1、y2、y3，求和得到y，对y进行隔5抽1，实现从153.6MHz到122.88MHz的变采样。

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