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申请/专利权人：成都玖锦科技有限公司

摘要：本发明公开了一种基于国产FPGA的本振模块的控制方法，包括基准环、主环两个锁相环，其中基准环为首先需要配置的环路，主要功能为提供频率稳定的参考输入信号给主环。主环在基准环配置完成后进行配置，主环的主要功能为最终输出稳定的频综信号或FM调制信号，本发明使用国产的可编程逻辑器件，旨在实现对本振模块的有效控制，该方法在通信领域和无线电频谱领域有广泛应用，通过国产FPGA芯片实现对本振的精确调节，提高系统性能和稳定性。

主权项：1.一种基于国产FPGA的本振模块的控制方法，其特征在于，该方法包括：步骤S1、本振模块上电后，FPGA执行复位，复位信号置1，延时计数器计数500ms后，复位信号置0；步骤S2、复位信号置0时，同时对DDS、基准环、主环启动初始化配置流程；步骤S3、当三个环的初始化配置完成后，进行初始化频率点计算，得到锁相环的配置分频比参数和极性参数；所述DDS芯片为首先需要配置的环路，完成对DDS的配置后，启动对基准环的配置流程，用于为提供频率稳定的参考输入信号给主环，主环在基准环配置完成后进行配置，主环用于最终输出稳定的频综信号或FM调制信号；所述步骤S2，包括：对DDS芯片基准环、调制模式参考输入，将数据转换为可被芯片接口识别的SPI数据格式，依次发送至配置寄存器Reg0：0x00B0、Reg4：0x0406004006、Reg0：0x0040；对基准环芯片，同样的调用SPI数据转换模块，依次发送初始化配置数据0x1FFA13、0x1FFA12、0x000010、0x000C19；对主环芯片，同样的调用SPI数据转换模块，依次发送初始化配置数据0x1DFA53、0x1DFA52、0x000010、0x000101；完成DDS的配置后，启动对基准环的配置流程，确定R分频参数和N分频参数；基准环配置流程包括：根据手册设计时序状态机对主环进行配置，状态机包含CFG_IDLE、CFG_DDS_STATE、CFG_R_STATE、CFG_N_STATE四个状态，状态机控制逻辑为：CFG_IDLE状态为待机状态，等待分频参数计算完成的触发信号到来，状态机跳转到CFG_DDS_STATE；CFG_DDS_STATE为R分频寄存器配置状态，等待DDS芯片配置完成的触发信号到来，调用SPI数据转换模块启动R寄存器配置流程，同时状态机跳转到CFG_R_STATE；CFG_R_STATE为N分频寄存器配置状态，等待R寄存器配置完成的触发信号到来，调用SPI数据转换模块启动N寄存器配置流程，同时状态机跳转到CFG_N_STATE；CFG_N_STATE为N寄存器配置等待状态，等待N寄存器配置完成的触发信号到来，状态机跳转回CFG_IDLE，继续等待下一个频点切换流程；主环配置流程包括：根据手册设计时序状态机对主环进行配置，状态机包含CFG_IDLE、CFG_POL_STATE两个状态，状态机控制逻辑为：CFG_IDLE状态为待机状态，判断当前的工作模式是否发生切换，当工作在单频点模式或基准环FM调制模式时，启动R分频的4分频寄存器配置流程，当工作在其他FM调制模式时，启动R分频的2分频寄存器配置流程，同时状态机跳转到CFG_POL_STATE，如果工作模式未发生切换，当接收到基准环配置完成的触发信号时，启动极性配置寄存器配置流程，同时状态机跳转到CFG_POL_STATE；CFG_POL_STATE为极性配置寄存器配置状态，接收到极性寄存器配置完成的触发信号时，状态机跳转到CFG_IDLE。

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