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申请/专利权人：三星显示有限公司
摘要：本实用新型的一实施例公开一种使通过下拉连接有输出电路的上拉晶体管的栅极的控制节点的电压的晶体管的电流路径的长度和电阻增加，最小化由于子晶体管之间的劣化差导致栅极驱动电路的不良的栅极驱动电路。多个级的每一个包括第一控制电路、第一输出电路以及第二输出电路；第一控制电路包括：第一晶体管，连接于第一输入端子和第一控制节点，并在第一输入端子连接有栅极；以及第二晶体管，连接于第一输入端子和第一控制节点，并在第二输入端子连接有栅极；第二晶体管包括串联的第一子晶体管和第二子晶体管，第一输入端子连接于前一级的第二输出电路的输出端子，第二输入端子连接于后一级的第二输出电路的输出端子，第二电压低于第三电压。
主权项：1.一种栅极驱动电路，包括多个级，其特征在于，所述多个级的每一个包括：第一控制电路，连接于输入第一电压的第一电压输入端子和输入低于所述第一电压的第二电压的第二电压输入端子，并控制第一控制节点及第二控制节点的电压电平；第一输出电路，连接于第一时钟端子和输入第三电压的第三电压输入端子，并根据所述第一控制节点和所述第二控制节点的电压电平输出栅极信号；以及第二输出电路，连接于第二时钟端子和所述第二电压输入端子，并根据所述第一控制节点和所述第二控制节点的电压电平输出进位信号；所述第一控制电路包括：第一晶体管，连接于第一输入端子和所述第一控制节点，并在所述第一输入端子连接有栅极；以及第二晶体管，连接于所述第一输入端子和所述第一控制节点，并在第二输入端子连接有栅极；所述第二晶体管包括串联的第一子晶体管和第二子晶体管，所述第一输入端子连接于前一级的第二输出电路的输出端子，所述第二输入端子连接于后一级的第二输出电路的输出端子，所述第二电压低于所述第三电压。
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