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申请/专利权人：云知声智能科技股份有限公司;厦门云知芯智能科技有限公司

摘要：本发明提供了一种DLL控制电路，包括：第一可变延时电路对输入时钟信号进行延时，得到第一时钟信号；延时电路对第一时钟信号进行延时，得到第二时钟信号；相位采样触发器对第一时钟信号的电平和第二时钟信号的电平进行采样，根据第一时钟信号和第二时钟信号的电平，得到多个输出值；鉴相器比较电路相位采样触发器输出的多个输出值，得到第一控制信号或者第二控制信号；延迟控制电路根据第一控制信号，控制第一可变延时电路增加延时或者根据第二控制信号减少延时；第二可变延时电路根据输入时钟信号的周期值和相位移位选择输入值，得到相位移位后的时钟信号。由此，通过数字电路实现对时钟信号的移相。

主权项：1.一种延迟锁相环DLL控制电路，其特征在于，所述DLL控制电路包括：第一可变延时电路，所述第一可变延时电路的第一输入端和时钟信号相连接，用于对输入时钟信号进行延时，得到第一时钟信号；延时电路，所述延时电路的输入端和所述第一可变延时电路的输出端相连接，用于对所述第一时钟信号进行延时，得到第二时钟信号；相位采样触发器，所述相位采样触发器的第一输入端和所述第一可变延时电路的输出端相连接，所述相位采样触发器的第二输入端和所述延时电路的输出端相连接，用于对所述第一时钟信号的电平和所述第二时钟信号的电平进行采样，根据所述第一时钟信号和所述第二时钟信号的电平，得到多个输出值；鉴相器比较电路，所述鉴相器比较电路的输入端和所述相位采样触发器的输出端相连接，用于根据所述相位采样触发器输出的多个所述输出值，得到第一控制信号或者第二控制信号；延迟控制电路，所述延迟控制电路的输入端和所述鉴相器比较电路的输出端相连接，用于根据所述第一控制信号，控制所述第一可变延时电路增加延时，或者，所述根据所述第二控制信号，控制所述第一可变延时电路减少延时，根据增加延时或者减少延时，得到所述输入时钟信号的周期值;第二可变延时电路，所述第二可变延时电路的第一输入端和所述延时控制电路的输出端相连接，所述第二可变延时电路的第二输入端和相位移位选择输入相连接，用于根据所述输入时钟信号的周期值和相位移位选择输入值，得到相位移位后的时钟信号。

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