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申请/专利权人：中国人民解放军国防科技大学
摘要：本发明提出一种基于FPGA的多边沿抽头延迟线型TDC编码器及其实现方法，属于时间数字转换技术领域。所述编码器包括：多跳变沿检测模块、分离模块、粗位置计数模块、模糊区域计数模块、累加模块以及数据使能检测模块。跳变沿检测模块将温度计码转换成独热码；分离模块对独热码进行移位处理以生成移位独热码，并结合温度计码生成分立模糊区域计数；粗位置计数模块根据移位独热码统计粗位置计数结果；模糊区域计数模块根据分立模糊区域计数统计模糊区域计数结果；累加模块将粗位置计数结果和模糊区域计数结果进行累加；数据使能检测模块从累加结果中获取解码结果并确定标志信号。本发明能够有效提升时间测量精度。
主权项：1.一种基于FPGA的多边沿抽头延迟线型TDC编码器，其特征在于，所述编码器包括：多跳变沿检测模块、分离模块、粗位置计数模块、模糊区域计数模块、累加模块以及数据使能检测模块；其中：所述多跳变沿检测模块被配置为：将温度计码转换成独热码；其中，所述温度计码和所述独热码分别被输入至所述分离模块；所述分离模块被配置为：对所述独热码进行移位处理，以生成移位独热码，并结合所述温度计码生成分立模糊区域计数；其中，所述移位独热码被输入至所述粗位置计数模块，所述分立模糊区域计数被输入至所述模糊区域计数模块；所述粗位置计数模块被配置为：根据所述移位独热码统计粗位置计数结果；其中，所述粗位置计数结果被输入至所述累加模块；所述模糊区域计数模块被配置为：根据所述分立模糊区域计数统计模糊区域计数结果；其中，所述模糊区域计数结果被输入至所述累加模块；所述累加模块被配置为：将所述粗位置计数结果和所述模糊区域计数结果进行累加，并输出累加结果；其中，所述累加结果被输入至所述数据使能检测模块；所述数据使能检测模块被配置为：从所述累加结果中获取解码结果并确定标志信号，输出所述解码结果和所述标志信号。
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权利要求：
百度查询： 中国人民解放军国防科技大学 一种基于FPGA的多边沿抽头延迟线型TDC编码器及其实现方法
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