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申请/专利权人：中科亿海微电子科技(苏州)有限公司

摘要：公开一种增量式提高FPGA时序性能的方法及装置，本发明首先调用时序分析获取时间裕度最小的连接集合C，然后对连接集合C中的每条连接c，首先执行增量装箱将c起点的BLE移动到c终点BLE所在的CLB，再增量装箱将c终点的BLE移动到c起点BLE所在的CLB；如果2次增量装箱中有一次是可行的，并且使得建立时间裕度最小值变好或者时间裕度最小的连接数量变少，则保持增量装箱的结果，更新连接集合C，并转入下一轮优化中；否则，还原增量装箱之前的结果，并转入集中C中下一条连接的优化中；因此本发明能够不修改原代码就实现时序收敛，提高时序性能，计算速度快，计算值准确。

主权项：1.一种增量式提高FPGA时序性能的方法，其特征在于：其包括以下步骤：（1）运行时序分析，备份当前时序延时，获取时间裕度最小的连接集合C，并标记连接C中的每条连接是可优化的；（2）判断C中是否有可优化的连接，如果有，找到集合C中的第一条可优化连接c；否则转入步骤（13）；（3）进行模拟增量装箱，判断是否可以增量装箱，但不实际进行增量装箱，将c起点的元器件移动到c终点元器件所在的元素簇，只改变元器件的坐标位置；（4）判断此次装箱是否是可行的，如果是，执行步骤（5），否则执行步骤（7）；（5）将元器件所在元素簇的s坐标和端口给布线，布线进行增量布线，影响的线网延时更新到时序网表，运行增量时序分析，获取最新建立的时间裕度最小值；（6）判断是否时间裕度最小值变好，或者时间裕度最小的连接数量变少，如果是，执行步骤（11），否则还原元器件坐标，还原布线结果，还原时序延时，并执行步骤（7）；（7）执行增量装箱，将c终点的元器件移动到c起点元器件所在的元素簇；将元器件所在元素簇的s坐标和端口给布线，布线进行增量布线，影响的线网延时更新到时序网表；（8）判断此次装箱是否是可行的，如果是，执行步骤（9），否则执行步骤（12）；（9）将元器件所在元素簇的s坐标和端口给布线，布线进行增量编译布线，影响的线网延时更新到时序网表，运行时序分析，获取最新建立的时间裕度最小值；（10）判断是否时间裕度最小值变好，或者时间裕度最小的连接数量变少，如果是，执行步骤（11），否则执行步骤（12）；（11）保留增量装箱结果，进行正式增量装箱和正式增量布线，备份时序延时，并更新最新时序分析结果的时间裕度最小的连接集合C；转入步骤（3）；（12）还原装箱结果，还原布线结果，还原元器件坐标，还原时序延时，并标记当前连接c为不可优化的；转入步骤（2）；（13）结束。

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