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申请/专利权人：无锡中微亿芯有限公司
摘要：本申请公开了一种通过松弛实例优化时序的FPGA布局方法，涉及FPGA技术领域，该方法通过解析逻辑网表并读取逻辑网表的布局约束条件，以确定两个端点实例各自的布局约束条件满足本申请针对的情况，且在已有的布局约束条件下时间裕量不满足时序要求的待处理时序路径，然后对待处理时序路径进行预处理，将待处理时序路径中的部分或全部的中间实例归属为松弛实例以先解除布局约束条件，从而使得后续的布局算法能够根据时序要求来调整这些实例的位置，使得待处理时序路径能够通过后续的布局算法修正满足时序要求，从而满足设计要求，提高设计效率并优化设计得到的FPGA的性能。
主权项：1.一种通过松弛实例优化时序的FPGA布局方法，其特征在于，所述FPGA布局方法包括：解析逻辑网表并读取所述逻辑网表的布局约束条件以确定待处理时序路径，所述待处理时序路径中的一个端点实例具有位于布局约束区域内的布局约束条件，另一个端点实例具有位于所述布局约束区域外的目标布局位置处的布局约束条件，所述待处理时序路径在包含的各个实例的布局约束条件下的时间裕量不满足时序要求；对于任意一条待处理时序路径，解除所述待处理时序路径中的松弛实例的布局约束条件使得所述待处理时序路径的时间裕量满足时序要求，松弛实例是所述待处理时序路径中除两个端点实例之外的中间实例；在所述逻辑网表的修正后的布局约束条件下对所述逻辑网表中的实例完成布局；确定待处理时序路径的方法包括：解析逻辑网表并确定待处理模块对应的子网表，待处理模块是包含至少一个待处理实例的模块，待处理实例是存在布局至对应的布局约束区域内的布局约束条件的实例；对于每个待处理模块，确定所述待处理模块中各个待处理实例对应的布局约束区域，并根据所述待处理模块的子网表确定所述待处理模块中的待处理时序路径。
全文数据：
权利要求：
百度查询： 无锡中微亿芯有限公司 一种通过松弛实例优化时序的FPGA布局方法
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