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摘要：本公开实施例公开了一种用于神经网络的缓冲运算电路、芯片及计算装置，其中，该电路包括：第一预设数量个运算单元、第一预设数量个缓冲单元、输入单元、输出单元和存储器；输入单元确定存储器中存储的输入张量包括的每个数据所属的窗口区域；从存储器中读取输入张量中的数据并输入对应的运算单元；运算单元对接收的数据进行运算，得到运算结果集合，并将运算结果集合输入对应的缓冲单元；输出单元在任意运算单元运算结束时，从对应的缓冲单元获取运算结果集合，并将运算结果集合作为输出张量包括的数据存入存储器。本公开实施例提高了缓冲单元的存储效率，降低了对存储器的访问次数，可以适用各种大小的张量，从而提高了电路应用的普适性。
主权项：1.一种用于神经网络的缓冲运算电路，包括：第一预设数量个运算单元、第一预设数量个缓冲单元、输入单元、输出单元和存储器，其中，运算单元和缓冲单元一一对应；所述输入单元，用于根据滑动窗口的大小和滑动步长，确定所述存储器中存储的输入张量包括的每个数据所属的窗口区域，其中，所述输入张量中的每个窗口区域对应于一个运算单元；从所述存储器中读取所述输入张量中的数据，并将读取的数据输入对应的运算单元；所述第一预设数量个运算单元中的运算单元，用于对接收的数据按照预设运算方式进行运算，得到运算结果集合，并将所述运算结果集合输入对应的缓冲单元；所述输出单元，用于在所述第一预设数量个运算单元中的任意运算单元运算结束时，从对应的缓冲单元获取运算结果集合，并将获取的运算结果集合作为输出张量包括的数据存入所述存储器。
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百度查询： 北京后摩智能科技有限公司 用于神经网络的缓冲运算电路、芯片及计算装置
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