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申请/专利权人：亚德诺半导体国际无限责任公司
摘要：本公开涉及自调谐锁相环PLL电路。实施方案可以涉及用于通过锁相环PLL电路控制时钟信号的技术或电路。该技术可以包括识别与数字控制振荡器DCO的增益有关的第一参数和与时间数字转换器TDC的分辨率有关的第二参数。然后，该技术可以包括基于第一参数和第二参数来识别与PLL电路的环路滤波器的滤波器系数有关的第三参数。然后，电路可以基于第一、第二和第三参数输出时钟信号。可以描述或要求保护其他实施方案。
主权项：1.一种通过锁相环PLL电路控制时钟信号的方法，其中，该方法包括：通过所述PLL电路识别与所述PLL电路的数字控制振荡器DCO的增益有关的第一参数；通过所述PLL电路识别与所述PLL电路的时间数字转换器TDC的分辨率有关的第二参数，其中基于向所述时间数字转换器提供测试信号并分析所述时间数字转换器响应于所述时间数字转换器接收所述测试信号而产生的输出，来识别所述第二参数；基于所述第一参数和所述第二参数，设置所述PLL电路的环路滤波器的系数，以修改所述PLL电路的环路增益；和通过所述PLL电路输出所述时钟信号，其中所述时钟信号基于所述环路滤波器的所述系数。
全文数据：
权利要求：
百度查询： 亚德诺半导体国际无限责任公司 PLL电路、电子设备及通过PLL电路控制时钟信号的方法
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