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申请/专利权人：海光信息技术(苏州)有限公司

摘要：本申请提供一种存储器读出电路，存储器内的数据运算方法及相关设备，涉及存储领域。存储器读出电路包括：主体电路，被配置为与存储器的存储阵列连接，用于存入第一数据；逻辑运算单元，与所述主体电路连接，所述逻辑运算单元被配置为与所述存储阵列连接；所述逻辑运算单元用于将所述第一数据与从所述存储阵列读出的第二数据进行逻辑运算，并将运算结果作为新的第一数据存入所述主体电路，以覆盖所述主体电路中原有的所述第一数据；所述主体电路还被配置为具有输出所述第一数据的能力。上述存储器读出电路，可以对数据进行处理，从而减少处理器访问存储器获取数据的频率，提高对数据的处理效率，同时减少数据传输的功耗。

主权项：1.一种存储器读出电路，其特征在于，包括：主体电路，被配置为与存储器的存储阵列连接，所述主体电路用于存入第一数据；逻辑运算单元，与所述主体电路连接，所述逻辑运算单元被配置为与所述存储阵列连接；所述逻辑运算单元用于将所述第一数据与从所述存储阵列读出的第二数据进行逻辑运算，并将运算结果作为新的第一数据存入所述主体电路，以覆盖所述主体电路中原有的所述第一数据；其中，所述主体电路还被配置为具有输出所述第一数据的能力；所述逻辑运算单元包括：多个逻辑运算模块，不同所述逻辑运算模块分别被配置为与所述存储阵列和所述主体电路连接；不同所述逻辑运算模块用于进行不同类型的逻辑运算；多路选择器，包括控制端、输出端和多个输入端，各所述输入端分别与不同所述逻辑运算模块连接，所述输出端与所述主体电路连接；所述控制端被配置与控制模块连接；所述逻辑运算模块包括执行与非运算的第一运算模块；所述第一运算模块包括第一与非门电路，所述第一与非门电路的输入端分别与所述存储阵列和所述主体电路连接，所述第一与非门电路的输出端与所述多路选择器的第一输入端连接；所述主体电路包括第一输出端和第二输出端，所述第一数据包括数据和数据，所述数据和所述数据构成差分信号，所述第一输出端用于输出所述数据，所述第二输出端用于输出所述数据；所述存储阵列包括第三输出端和第四输出端，所述第二数据包括数据和数据，所述数据和所述数据构成差分信号，所述第三输出端用于输出所述数据，所述第四输出端用于输出所述数据；所述第一与非门电路的输入端分别与所述第一输出端和所述第三输出端连接；所述逻辑运算模块还包括执行或运算的第三运算模块，所述第三运算模块包括第二与非门电路；所述第二与非门电路的输入端分别与所述第二输出端和所述第四输出端连接；所述第二与非门电路的输出端与所述多路选择器的第三输入端连接。

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