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摘要：本发明公开了基于FPGA实现大规模DDC的方法及系统，包括以下步骤：设置DDC的带宽、中心频率、延时长度参数并进行缓存；将宽带数据划分为多个信道；将各信道的宽带数据分别写入DDR3存储器缓存；根据输入的参数读取DDR3存储器缓存的一定长度的宽带数据，记录当前读出的宽带数据的频率控制字、相位、延时长度参数进行缓存。对读出的宽带数据进行DDC处理。使用本地时钟，快速地将宽带数据划分为多个信道全部写入DDR3存储器中，写入时每路信道化宽带数据都有与之对应的起始地址，进行延时输出实现全频段实时输出功能和在线回放功能和宽带延时功能的，可以实现大规模的DDC的数字信号处理需求。
主权项：1.基于FPGA实现大规模DDC的方法，其特征在于：包括以下步骤：步骤1：设置DDC的带宽、中心频率、延时长度参数并进行缓存；步骤2：将宽带数据划分为多个信道；将各信道的宽带数据分别写入DDR3存储器缓存；步骤3：根据输入的参数读取DDR3存储器缓存的一定长度的宽带数据，记录当前读出的宽带数据的频率控制字、相位、延时长度参数进行缓存；所述步骤3包括以下步骤：步骤31：首次读取时，输入带宽、中心频率、延时长度参数，读取DDR3存储器缓存的一定长度的宽带数据，记录当前读出的宽带数据的频率控制字、相位、延时长度参数进行缓存；步骤32：再次读取时，输入上次缓存的频率控制字、相位、延时长度参数，读取DDR3存储器缓存的一定长度的宽带数据，该宽带数据包含上次读取的宽带数据的最后一段宽带数据，记录当前读出的宽带数据的频率控制字、相位、延时长度参数进行缓存；在处理过程中需要对不同的宽带数据分别进行分时DDC处理，每次DDC处理前将本路宽带数据的频率控制字、带宽、相位这3个参数预先读出来，相位用于设置DDS的初始相位，其中频率控制字和带宽为外部输入参数，同时数据需要多读上次处理的最后一段数据，用于恢复现场，相位作为内部参数，当本次处理完以后需要将下次处理的初始相位计算出来进行缓存，便于下次处理使用；步骤4：对读出的宽带数据进行DDC处理。
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