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申请/专利权人：陕西亚成微电子股份有限公司

摘要：公开了一种反激式ACDC控制芯片的输出短路频率限制电路及方法，电路中，频率限制单元的输入端与反激式ACDC控制芯片的供电vdd端和gnd端连接，频率限制单元的输出端与反激式ACDC控制芯片的逻辑模块连接，过载保护判断模块用于判断反激式ACDC控制芯片输出端是否因短路而导致过载，第一频率计时模块用于计时第一频率的时间，第二频率计时模块用于计时第二频率的时间，频率限制选择模块用于基于过载保护判断模块的判断结果选择输出第一频率计时模块的频率或第二频率计时模块的频率。本电路通过降低最小工作频率，延长退磁时间，消除输出短路时初次级电压尖峰过高的问题。

主权项：1.一种反激式ACDC控制芯片的输出短路频率限制电路，其特征在于，其包括设于反激式ACDC控制芯片中的频率限制单元，频率限制单元的输入端与反激式ACDC控制芯片的供电vdd端和gnd端连接，频率限制单元的输出端与反激式ACDC控制芯片的逻辑模块连接，频率限制单元包括，过载保护判断模块，其用于判断反激式ACDC控制芯片输出端是否因短路而导致过载，过载保护判断模块包括将芯片FB引脚的电压与预设第一阈值电压进行比较判断判断是否过载的比较器，芯片FB引脚的电压大于等于预设第一阈值电压，过载保护判断模块判断过载；第一频率计时模块，其用于计时第一频率的时间，电流源I1的输入端与供电vdd端连接，电流源I1的输出端与NMOS管MN1的漏极连接，NMOS管MN1的栅极与drive驱动信号连接，电容C1的一端与I1的输出端连接，另一端与gnd端连接；第二频率计时模块，用于计时第二频率的时间，电流源I2的输入端与供电vdd端连接，电流源I2的输出端与NMOS管MN2的漏极连接，NMOS管MN2的栅极与drive驱动信号连接，电容C2的一端与I2的输出端连接，另一端与gnd端连接；频率限制选择模块，其用于基于过载保护判断模块的判断结果选择输出第一频率计时模块的频率或第二频率计时模块的频率，NMOS管MN3和PMOS管MP1、NMOS管MN4和PMOS管MP2分别组成两个传输门，传输门交替开启，NMOS管MN3和PMOS管MP1漏极与漏极极相连且与电容C1的一端连接，NMOS管MN3的源极与PMOS管MP1的源极连接，NMOS管MN4的漏极和PMOS管MP2的漏极极连接且与电容C2的一端连接，NMOS管MN4的源极与PMOS管MP2的源极连接，PMOS管MP1与NMOS管MN4的栅极相连，NMOS管MN3和PMOS管MP2的栅极相连，PMOS管MP2的源极和PMOS管MP1的源极相连后输入比较器U4的同向输入端，比较器U4的反向输入端接第二阈值电压。

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